[반도체 경제학 6편] 모래에서 칩까지 — 웨이퍼에 수십억 개의 회로를 새기는 법
📌 도입 — "손톱보다 작은 칩에 어떻게 수십억 개가 들어가나요?"
안녕하세요, 오십보입니다.
1편에서 배웠습니다. 트랜지스터는 전기를 켜고 끄는 스위치입니다. 2023년 애플 M3 Max 칩 하나에는 이 스위치가 920억 개 들어 있습니다. 칩 크기는 가로세로 약 3cm, 손톱만 합니다.
손톱만 한 면적에 920억 개를 어떻게 집어넣을까요?
4편에서는 모래로 웨이퍼를 만드는 법을 배웠고, 5편에서는 그 재료를 둘러싼 국가 간 소재 전쟁을 살펴봤습니다. 이제 그 웨이퍼가 공장 안으로 들어온 뒤 어떤 일이 벌어지는지, 반도체 제조 공정의 핵심을 초보자 언어로 풀겠습니다.
◼ 1부 — 반도체 제조의 큰 그림: '인쇄'다
반도체 제조 공정은 기본적으로 초정밀 인쇄술입니다.
웨이퍼라는 종이 위에 회로 패턴이라는 그림을 수십~수백 번 반복해서 찍어내는 과정입니다. 잉크 대신 빛과 화학물질을 쓰고, 그림의 해상도는 머리카락 굵기의 수만분의 1 수준이지만, 본질적인 구조는 인쇄입니다.
이 과정은 업계에서 흔히 '반도체 8대 공정'이라는 큰 덩어리로 묶어 설명합니다.
단계 공정명 한마디 설명
| 1 | 웨이퍼 제조 | 모래 → 실리콘 → 웨이퍼 (4편에서 다룸) |
| 2 | 산화(Oxidation) | 웨이퍼 표면에 보호막 형성 |
| 3 | 포토(Photo, 노광) | 빛으로 회로 패턴을 찍는다 ← 핵심 |
| 4 | 에칭(Etch, 식각) | 불필요한 부분을 깎아낸다 |
| 5 | 이온 주입(Implant) | 불순물을 심어 전기 특성을 바꾼다 |
| 6 | 증착(Deposition) | 새로운 막을 쌓는다 |
| 7 | CMP(연마) | 표면을 유리처럼 평탄하게 간다 |
| 8 | 배선·패키징 | 회로를 연결하고 케이스에 넣는다 |
이 8단계는 회사·문헌마다 세부 순서와 명칭이 조금씩 다르게 소개되기도 하지만, 큰 흐름은 대체로 이렇게 이해하면 됩니다. 이 중 3번 포토 공정이 전체 공정의 심장입니다. 오늘은 여기에 집중합니다.
◼ 2부 — 포토리소그래피: 반도체 판화의 원리
포토리소그래피(Photolithography)를 한 단어로 설명하면 "빛으로 하는 판화"입니다.
① 감광액 도포 — 웨이퍼 표면에 포토레지스트(Photoresist)라는 빛에 민감한 화학물질을 얇게 바릅니다. 2019년 일본이 한국에 대한 수출 규제 품목으로 지정했던 대표적 소재 중 하나가 바로 이 포토레지스트입니다. 이 막이 사진의 필름 역할을 합니다.
② 노광(Exposure) — 포토마스크(Photomask)는 회로 설계도가 새겨진 유리판입니다. 이 마스크 아래에 웨이퍼를 놓고 강한 빛을 쏘면, 마스크의 패턴이 포토레지스트에 투영됩니다.
③ 현상(Develop) — 빛을 받은 부분과 받지 않은 부분은 화학적 성질이 달라집니다. 현상액을 뿌리면 한쪽은 남고 한쪽은 녹아 사라지면서 회로 패턴이 웨이퍼 위에 드러납니다.
④ 에칭(Etch) — 남은 포토레지스트를 보호막으로 삼고, 화학물질이나 플라즈마로 그 아래 실리콘 층을 정밀하게 깎아냅니다.
⑤ 포토레지스트 제거 — 임무를 마친 포토레지스트를 제거하면, 회로 패턴이 실리콘 위에 그대로 새겨진 상태가 됩니다.
이 다섯 단계가 포토 공정의 한 사이클입니다. 현대 첨단 칩은 이 층이 수십 층에 달하기 때문에 포토 공정만 수십 번 반복됩니다. 이것이 반도체 공장에 클린룸이 필요하고, 먼지 한 톨이 값비싼 웨이퍼 전체를 망칠 수 있는 이유입니다.
◼ 3부 — 빛의 파장이 반도체의 한계를 결정한다
포토 공정의 핵심은 "얼마나 작은 패턴을 찍을 수 있느냐"입니다. 이것이 곧 공정 미세화, '몇 nm 공정인가'를 결정합니다.
패턴의 최소 크기는 사용하는 빛의 파장에 크게 좌우됩니다. 정확한 관계식은 공정 조건마다 달라지지만, 초보자 관점에서는 대략 "파장이 짧을수록, 렌즈의 개구수(NA)가 클수록 더 작은 패턴을 새길 수 있다" 정도로 이해하면 충분합니다.
이 원리 때문에 반도체 업계는 더 짧은 파장의 빛을 찾아 끊임없이 진화해왔습니다.
세대 광원 파장 적용 공정(대략) 대표 장비 제조사
| 1세대 | 수은등 i-line | 365nm | 250nm 이상 | 니콘, 캐논 |
| 2세대 | KrF 엑시머 레이저 | 248nm | 130~250nm대 | ASML, 니콘 |
| 3세대 | ArF 엑시머 레이저 | 193nm | 90~130nm대 | ASML |
| 4세대 | ArF 액침(Immersion) | 193nm(물 굴절) | 7~90nm대 | ASML |
| 5세대 | EUV | 13.5nm | 7nm 이하 | ASML 독점 |
현재 최첨단 칩(3nm, 2nm급)을 만들려면 EUV(Extreme UltraViolet, 극자외선) 노광 장비가 사실상 필수입니다. 그리고 이 장비를 만드는 회사는 전 세계에 단 하나, 네덜란드의 ASML입니다.
◼ 4부 — ASML: 반도체 업계의 진짜 '슈퍼 갑'
ASML은 네덜란드 에인트호번에 본사를 둔 회사로, EUV 노광장비를 만드는 전 세계 유일한 기업입니다.
EUV 장비 한 대는 무게 약 15만kg, 부품 수 약 10만 개, 조립에 수십 개국의 부품이 들어가는 초정밀 기계입니다. 기존 Low-NA EUV 장비는 대당 대략 2억 달러 중후반대(약 2,500억~2,700억 원 안팎)로 알려져 있고, 2025년부터 본격 양산되는 차세대 High-NA EUV 장비는 대당 약 3억 8,000만 달러 안팎(약 5,000억 원대 중반)에 이르는 것으로 보도됩니다.
ASML은 AI 칩 수요 증가에 대응해 Low-NA·DUV 장비 생산 능력을 확대하며 연간 수십 대 규모의 EUV 장비를 출하하는 계획을 밝히고 있고, 삼성전자를 비롯한 주요 파운드리 업체들도 2025~2026년 사이 High-NA EUV 장비를 순차적으로 도입하는 로드맵을 갖고 있습니다.
왜 이게 중요할까요? ASML이 없으면 최첨단 반도체를 만들 수 없습니다. 미국이 중국에 대한 반도체 제재의 핵심 수단으로 ASML의 중국 수출을 제한해온 이유가 바로 이것입니다. 장비 하나가 국가 안보 자산이 된 세상입니다.
◼ 5부 — 3nm, 2nm: 숫자의 진실
뉴스에서 "3nm 공정", "2nm 공정"이라는 말이 자주 나옵니다. 이 숫자는 정확히 무엇을 의미할까요?
사실 현재의 nm 숫자는 트랜지스터 게이트의 실제 물리적 크기와 정확히 일치하지 않습니다. 공정이 복잡해지면서 각 회사가 붙인 명칭에 가깝습니다. 그보다는 "같은 면적에 얼마나 많은 트랜지스터를 넣을 수 있느냐(트랜지스터 밀도)"와 "전력 효율은 얼마나 좋아지느냐"가 실질적인 비교 기준입니다.
현재 최첨단 공정 현황(2026년 기준, 로드맵 포함):
기업 현재 최선단 공정 상태
| TSMC | 2nm(N2) | 2025년 4분기 양산 개시 |
| TSMC | 1.6nm급(A16) | 2026~2027년 시장 진입 목표 |
| 삼성 파운드리 | 2nm(SF2) | 2025년 말~2026년 사이 양산 로드맵 |
| 인텔 파운드리 | 18A | 2025~2026년 시험 생산 단계 |
TSMC가 2nm 공정 양산을 2025년 4분기에 시작하면서 앞서 나갔습니다. 삼성 파운드리는 3nm 공정에서 수율(정상 칩 비율) 확보에 어려움을 겪었다는 보도가 여러 차례 나왔습니다. 초기에는 수율이 20~30%대에 그쳤다는 보도도 있었고, 이후 개선되긴 했지만 한동안 50% 안팎에서 고전했다는 기사들도 있습니다. 2nm에서는 이런 수율 문제를 만회하는 것이 삼성의 핵심 과제로 꼽힙니다.
◼ 6부 — 수율: 반도체 공장의 성적표
수율(Yield)은 반도체 제조의 핵심 지표로, 웨이퍼 하나에서 만든 칩 중 정상 작동하는 칩의 비율을 뜻합니다.
수율(%) = 정상 칩 수 ÷ 전체 칩 수 × 100
수율이 50%라면 만든 칩의 절반이 불량품이라는 뜻입니다. 웨이퍼 가격, 공정 비용은 수율과 상관없이 동일하게 들어가므로, 수율이 낮으면 원가가 치솟고 기업 경쟁력은 무너집니다. 첨단 공정에서는 대체로 수율이 70~80% 이상은 돼야 수익성 있는 양산이 가능하다고 봅니다.
공정이 미세해질수록 수율을 높이는 것이 기하급수적으로 어려워집니다. 트랜지스터 하나의 크기가 원자 수십 개 수준에 불과하기 때문에, 먼지 한 톨, 진동 하나, 미세한 온도 차이가 불량을 만들 수 있습니다. 이것이 반도체 공장이 항상 클린룸(Clean Room) 안에 있는 이유입니다. 반도체 공정용 클린룸의 먼지 농도는 등급에 따라 일반 대기의 수천분의 1에서, 가장 엄격한 등급에서는 수만분의 1 수준까지도 낮춥니다.
삼성 파운드리가 3nm에서 수율 문제로 고객을 일부 잃은 것은 단순한 기술 실패가 아닙니다. 대형 고객들은 수율이 낮으면 납기를 맞추기 어렵고 불량 칩 처리 비용도 늘어나기 때문에 경쟁사로 이탈합니다. 고객이 이탈하면 물량이 줄고, 물량이 줄면 수율을 올릴 학습 기회도 줄어드는 악순환에 빠지게 됩니다.
◼ 7부 — 공정 경쟁이 만드는 산업 지형
이 공정 경쟁의 결과가 3편에서 배운 파운드리 시장 구조를 만들었습니다.
TSMC는 최근 파운드리 시장에서 70%를 훌쩍 넘는, 갈수록 확대되는 점유율을 차지하고 있는 것으로 분석됩니다. 이는 단순히 먼저 시작해서가 아니라, 수십 년간 수율 관리와 공정 개발에 집중 투자하면서 ASML과의 협력 관계를 가장 깊이 구축해온 결과입니다. TSMC는 ASML EUV 장비의 최대 고객 중 하나이자, EUV 공정 개발 초기 단계부터 함께해온 공동 개발 파트너에 가깝습니다.
반면 삼성전자는 메모리와 파운드리를 동시에 하는 IDM(종합반도체) 모델이라 내부 자원이 분산됩니다. TSMC는 오직 파운드리만 합니다. 고객사 칩 설계를 빼앗아 갈 우려가 없기 때문에 애플도, 엔비디아도, AMD도 TSMC를 믿고 설계 도면을 맡깁니다.
이것이 한국이 메모리에서는 세계 최상위권이면서 파운드리에서는 한 자릿수 점유율에 머무는 구조적 이유 중 하나입니다.
📌 정리 — 세 줄 요약
첫째, 반도체 제조의 핵심은 초정밀 인쇄술입니다. 빛으로 회로 패턴을 웨이퍼에 수십 번 찍어내는 포토리소그래피가 전체 공정의 심장입니다.
둘째, 더 짧은 파장의 빛을 쓸수록 더 작은 회로를 새길 수 있고, 현재 최첨단 EUV 장비는 전 세계에서 ASML만 만듭니다. 이 장비가 없으면 3nm 이하 첨단 칩은 만들 수 없습니다.
셋째, TSMC는 2025년 4분기 2nm 양산을 시작했고, 삼성 파운드리는 수율 문제를 극복하며 뒤를 좇고 있습니다. 이 수율 경쟁이 곧 파운드리 시장 점유율 경쟁으로 이어집니다.
💬 오십보 한마디
반도체 공정을 공부하고 나서 ASML의 장기 주가 흐름을 다시 살펴봤습니다. 2010년대 초반 이후 수십 배 수준으로 오른 것으로 알려져 있습니다. 세상에서 유일한 물건을 만드는 회사의 주가가 어떻게 되는지를 보여주는 사례입니다. 공정 기술의 흐름을 이해하면 어떤 기업이 그 흐름의 중심에 있는지도 보이기 시작합니다.
다음 7편에서는 팹리스·파운드리·IDM이라는 반도체 산업의 세 가지 사업 모델을 비교하고, 엔비디아·TSMC·삼성·퀄컴이 이 구조 안에서 어떤 포지션을 차지하고 있는지 풀겠습니다.
오늘도 한 걸음, 오십보.
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